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Dieses Verfahren ist eine Verbesserung des Zählverfahrens.
Der Nachteil der Wandlung mittels eines Zählvorganges ist ihre Langsamkeit. Für die Genauigkeit von 3 ½ Stellen sind im Extremfall 1999 Taktimpulse nötig, ehe das Meßergebnis feststeht.
Eine bedeutend schnellere Methode ist, mit jedem Taktimpuls ein Bit des Digitalwortes festzulegen. Ein Wandler mit 3 ½ Dezimalstellen Genauigkeit, was einer Auflösung von 11 Bit entspricht, würde anstatt 2000 Impulsen nur noch 11 benötigen.
Wandler nach diesem Verfahren enthalten ein Register, das zu Beginn der Umsetzung auf einen mittleren Wert gesetzt wird (10000000). Ein an dieses Register angeschlossener D/A-Wandler erzeugt eine entsprechende Spannung, die natürlich in der Mitte des Aussteuerungsbereiches ist. Das Prinzip ist nun, die Ausgangsspannung des D/A Wandlers schrittweise an die Eingangsspannung anzugleichen. Stimmen beide Spannungen überein, enthält das Register den gesuchten Digitalwert.
Dazu vergleicht der Komparator ständig die Eingangsspannung mit dem analoggewandelten Registerwert. Liegt die Eingangsspannung oberhalb des halben Aussteuerbereiches, bleibt es gesetzt, liegt die Eingangsspannung niedriger, wird das MSB gelöscht. Im nächsten Schritt wird das zweithöchste Bit gesetzt, und auf gleiche Weise entschieden, ob es gesetzt bleiben kann oder nicht. Das SAR beinhaltet bereits die notwendige Steuerlogik.
Bedingung für die einwandfreie Funktion eines Wandlers nach diesem Verfahren ist, daß sich die Eingangsspannung während des Wandlungsvorganges nicht mehr ändert (-> Sample / Hold)
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